Biblioteki napisane w VHDL
upduino-projects
Różne projekty VHDL, nad którymi pracowałem dla Upduino v2.0 i v3.0.
- 6
- GNU General Public License v3.0 only
hVHDL_fpga_interconnect
magistrala łącząca napisana w języku VHDL do uzyskiwania dostępu do danych w modułach FPGA.
- 5
- MIT
hVHDL_gigabit_ethernet
Biblioteka VHDL do syntetyzowalnego minimalnego gigabitowego Ethernetu z interfejsem RGMII, minimalnym ethernetem, parserami nagłówków ip i udp.
- 4
- MIT
minitel2.0
Zbudowanie nowoczesnej jednostki obliczeniowej ze starego minitela do zastosowań domowych.
- 4
- GNU General Public License v3.0 only
Xilinx-DPUV3.0-Vivado-Proj
Integracja Deep Learning Processing Unit (DPU IP) z Application Processing Unit (APU) przy użyciu (Zynq-7000 PS) w pakiecie Xilinx Vivado Design Suite.
- 2
VHDL_real_time_simulation
Prosty projekt na wpis na bloga z syntezowalnymi modelami konwerterów buck.
- 0
- MIT
MultiCPU_Microprocessor
To był ostatni projekt dla CS-401 Computer Architecture. Mikroprocesor został zbudowany przy użyciu VHDL w Xilinx Vivado. Moja grupa postanowiła zbudować coś w rodzaju GPU, które mogłoby wykonywać wiele prostych obliczeń jednocześnie.
- 0
MaquinaDeVendas
Projeto apresentado para obtenção de nota parcial na disciplina de Circuítos Digitais, da Universidade Tecnológica Federal do Paraná, camp Apucarana..
- 0